Browsing by Author "JOU JING-YANG"
Now showing 1 - 20 of 41
- Results Per Page
- Sort Options
Item type:Item, SOC系統整合設計驗證及測試環境建置(2003) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系Item type:Item, 交大電子系周景揚教授參加國際標準組織會議(2000) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 低功率超大型積體電路與電腦輔助設計之研究---子計畫二:滲合不同電壓設計方式的低功率設計以及電腦輔助設計之研究(1996) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系對於特殊以及一般用途積體電路, 平均功率 消耗已經演變成一個重要的設計參數,一個用 來做快速估算功率消耗的公式如下: P = f Vdd ^2 .SIGMA. (Pi Ci) f: 頻率, Vdd: 電壓供應源伏特數, N: 全部數目的內部點Pi: 第i個內部點的平均交 換活動,Ci: 第i個內部點之電容現有降低功率 消號的技術多集中在怎麼來降低各個電路內部 點平均的交換活動, 這些技術被運用在不同層 次的電路上.但是我們很清楚的從前面功率消 耗的公式上看出,只要降低電力供應源的電壓, 我們就能快速的降低功率消耗, 當然在這同時 , 電路的速度也會因而減慢.為了達到低功率消 耗又不減慢電路速度, 一些半導體公司已經常提供給客戶一些standard cell libraries, 在同一晶 片上可以滲合不同電壓源的邏輯閘,所以只要 我們把低壓的邏輯閘用在電路內屬於不需要快 速的部份上, 我們就能達到降低功率消耗但同 時保有原來速度的設計了.基於以上的觀察, 在 本計畫中, 我們將針對這個滲合不同電壓源的 設計型態, 研發如何區隔以及最佳化方面的軟 體.以降低功率消耗同時不損及功能的需求.Item type:Item, 使用60GHz之室內十億級位元傳輸率之無線基頻傳收機---子計畫三:針對通訊數位訊號處理器之電子系統層級驗証與合成環境(I)(2008) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系及電子研究所在傳統的數位系統設計中,通常從一個高階抽象層的描述語言開始設計,如C/C++或MATLAB。經過驗証所設計的演算法與規格相符後,設計者開始手動轉換這些演算法到硬體設計。由於演算法通常使用高精度浮點運算 (floating point, FP)。然基於性能和成本的考量,硬體通常只使用定點運算 (fixed point, fp)。因此,浮點數至定點的轉換是一定需要。其中一個主要的設計挑戰,是以有限位數計算結果,同時維持正確性。 此外,傳統的高階合成流程 (high-level synthesis flow)中所需要的位元數是由設計者指定,而不是設計工具自動決定。在日益複雜的系統中,設計者手動最佳化位元數不再是容易的事。因此,精確的位元數分析應該納入目前的合成流程。在本計畫中,我們將提出一個浮點數到定點數的驗証及合成系統 (Floating Point to Fixed Point Conversion, FP2C)自動將高階層的浮點演算法轉化為低階層定點數的硬體實作。 在計畫的第一年裡,我們將著重於自動量化 (autoqunatization)的過程並且考慮硬體需求。在傳統的設計流程中,通常在演算法階層執行量化過程,完全沒考慮未來硬體需求。有可能導致一個非最佳的硬體設計。相反地,在執行量化的過程中,先將系統架構納入考慮,再驗証量化的結果是否符合設計要求,將能讓系統設計最佳化。一個管線架構的FFT處理器的個案研究,將用來示範新建議流程所帶來的改善。 在計畫的第二年裡,我們將著重於多位元的運算單元 (functional unit)排程(scheduling)與配置(allocation)。我們不但考慮運算單元的種類,還將考慮運算單元的位元數,並且動態地同時執行運算單元排程與配置的動作,讓新提出的驗証及合成流程能將設計的硬體面積縮到最小。 在計畫的第三年裡,我們將著重於連線導向的多位元暫存器配置與綁定 (binding)。除了暫存器的數目會影響到硬體面積,此外,暫存器的位元數與連接的導線亦可能嚴重影響硬體面積。因此,我們將提出新的演算法,藉以減少整體硬體所需之面積。Item type:Item, 使用60GHz之室內十億級位元傳輸率之無線基頻傳收機---子計畫三:針對通訊數位訊號處理器之電子系統層級驗証與合成環境(II)(2009) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系及電子研究所Item type:Item, 使用60GHz之室內十億級位元傳輸率之無線基頻傳收機---子計畫三:針對通訊數位訊號處理器之電子系統層級驗証與合成環境(III)(2010) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系及電子研究所Item type:Item, 出席1999年國際工程教育會議(2000) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片寬頻無線通訊系統設計技術之研究---子計畫IV:單晶片系統上佈局驅動的資料路徑編譯器之研究(2001) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片系統之電腦輔助設計研究(2000) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片系統之電腦輔助設計研究(II)(2000) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系Item type:Item, 單晶片系統之電腦輔助設計研究(III)(2001) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片系統驗證之核心技術開發---子計畫二:針對單晶片系統界面協定之驗證(II)(2006) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片系統驗證之核心技術開發---子計畫二:針對單晶片系統界面協定之驗證(III)(2007) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系及電子研究所Item type:Item, 單晶片系統驗證之核心技術開發---總計畫(II)(2006) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片系統驗證之核心技術開發---總計畫(III)(2007) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系及電子研究所Item type:Item, 單晶片系統驗證之核心技術開發-子計畫二:針對單晶片系統界面協定之驗證(I)(2005) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 單晶片系統驗證之核心技術開發-總計畫(I)(2005) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 在多核心架構上考慮效能與功耗問題的系統設計方法(2012) ;周景揚 ;JOU JING-YANG國立交通大學電子工程學系及電子研究所即使多核心系統已成為一般及嵌入式運算系統之主流,系統功耗及記憶體瓶頸仍然 限制了系統中的核心擴展性(Scalability)及平行性(Concurrency)。多核心性統同時也須考 慮溫度及電池之問題。執行序之間的親和度(Affinity)也限制了系統資源的使用率而產 生暗石夕晶(Dark Silicon)。 區域性(Locality)及附載平衡(Load Balance)為兩個和多心系統效能有關的重要的設 計問題。然而,針對單一問題而做出的最佳化可能導致另一問題更加嚴重,反之亦然。 而這兩個高度相關的問題需要一個協同的最佳化設計方法。而且,動態電壓及頻率 (dynamic voltage and frequency scaling)調整及功耗管理的技巧可能更進一步動態的調 整系統中處理器的運算能力並可能導致附載不平衡的問題。此計晝將為高平行度應用 發展高效率的區域性(Locality)及附載平衡(Load Balance)之最佳化方法。 在本計晝中,有三個關於功耗管理(Power Management)的問題將被考慮,分別是能 量消耗、溫度及效能。降低能量消耗或是溫度會造成一些效能上的損失,包含比較低 的運算速度,以及開關處理器造成的時間延遲問題。在這個計晝中,我們將會把此一 問題與負載平衡(Load Balancing)的問題一起做最佳化,以達到更短的整體運算時間。 由於本計晝著重於多核心系統架構(Many-Core Architecture),因此我們將會設計線上 (online)且可擴展(scalable)的功耗管理政策。 儘管如此,目前的設計環境仍然缺少一個有效的方法論以提供大量的設計可能性探 索。在這份計劃中,我們將會考慮在多核心系統中兩個重要的議題,也就是速度及功 耗。此計晝預計的流程如下:第一年我們將會考慮靜態的區域性最佳化並準備基礎的 功耗管理政策,第二年則將發展考慮附載平衡的動態執行緒管理方法及階層式功耗管 理技術,而最後一年我們將在特殊系統架構下進行效能與功耗的同時最佳化 (Co-Optimization)。整合三年的成果後,我們將提出一個適用於多核心架構下跨層級且 多目標(Cross-Layer Multi-Objective)的設計流程。Item type:Item, 多媒體系統晶片設計技術之研究---子計畫V:系統晶片上系統驗證之研究(I)(1999) ;周景揚 ;JOU JING-YANG交通大學電子工程系Item type:Item, 多媒體系統晶片設計技術之究---子計畫V:系統晶片上系統驗證之研究(II)(2000) ;周景揚 ;JOU JING-YANG交通大學電子工程系