對以智財單元為基系統晶片設計之驗證與測試技術開發研究---子計畫一：與組織探索階段互動之系統階層驗證技術
| dc.contributor.author | 董蘭榮 | en_US |
| dc.contributor.author | Dung Lan-Rong | en_US |
| dc.contributor.department | 國立交通大學電機與控制工程學系 | zh_TW |
| dc.date.accessioned | 2014-12-13T10:29:27Z | |
| dc.date.available | 2014-12-13T10:29:27Z | |
| dc.date.issued | 2000 | en_US |
| dc.description.sponsorship | 行政院國家科學委員會 | zh_TW |
| dc.identifier.govdoc | NSC89-2215-E009-119 | zh_TW |
| dc.identifier.uri | https://www.grb.gov.tw/search/planDetail?id=583941&docId=109719 | en_US |
| dc.identifier.uri | https://ir.lib.nycu.edu.tw/handle/11536/89299 | |
| dc.language.iso | zh_TW | en_US |
| dc.title | 對以智財單元為基系統晶片設計之驗證與測試技術開發研究---子計畫一：與組織探索階段互動之系統階層驗證技術 | zh_TW |
| dc.title | System-Level Verification Interacting with Architecture Exploration | en_US |
| dc.type | Plan | en_US |