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混合信號積體電路之核心設計技術-子計畫二:100 Gbps/400 Gbps 多通道, 高性能串列傳輸接收機
混合信號積體電路之核心設計技術-子計畫二:100 Gbps/400 Gbps 多通道, 高性能串列傳輸接收機
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Date
2016
Authors
陳巍仁
Journal Title
Journal ISSN
Volume Title
Publisher
DOI
Abstract
Description
Keywords
,
Citation
URI
https://www.grb.gov.tw/search/planDetail?id=11877022&docId=484714
https://ir.lib.nycu.edu.tw/handle/11536/131792
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