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dc.contributor.author李鎮宜en_US
dc.contributor.author林昱偉en_US
dc.date.accessioned2014-12-16T06:16:56Z-
dc.date.available2014-12-16T06:16:56Z-
dc.date.issued2009-08-21en_US
dc.identifier.govdocG06F017/14zh_TW
dc.identifier.govdocH04L005/00zh_TW
dc.identifier.urihttp://hdl.handle.net/11536/106174-
dc.description.abstract本案提出一種應用於超寬頻(UWB)系統的管線快速傅立葉轉換(FFT)處理器,包括:用以實行基底-2(radix-2)FFT演算的一第一模組、用以實行基底-8FFT演算的一第二模組、用以實行基底-8FFT演算的一第三模組、複數個共軛區塊(conjugate blocks)、一除法區塊以及複數個多工器。所提出之被稱為混合基底多路徑延遲迴授(Mixed-RadixMulti-Path Delay Feedback)的管線FFT結構係藉由使用多資料路徑配置而能夠提供較高的產量率,本案之處理器係使用高基底FFT演算法以降低複雜之乘法演算的數目zh_TW
dc.language.isozh_TWen_US
dc.title高產量管線式快速傅立葉轉換處理器zh_TW
dc.typePatentsen_US
dc.citation.patentcountryTWNzh_TW
dc.citation.patentnumberI313824zh_TW
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  1. I313824.pdf

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