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dc.contributor.author柯明道en_US
dc.contributor.author陳穩義en_US
dc.date.accessioned2014-12-16T06:17:21Z-
dc.date.available2014-12-16T06:17:21Z-
dc.date.issued2005-05-01en_US
dc.identifier.govdocH01L023/60zh_TW
dc.identifier.govdocH01L023/60zh_TW
dc.identifier.urihttp://hdl.handle.net/11536/106390-
dc.description.abstract本發明係一種靜電放電防護電路,其應用於具有高低壓混合介面之電路上,本發明利用閘極耦合技術來達到靜電放電防護效果,當靜電發生於輸入/輸出銲墊時,一電容會耦合靜電電壓,並分別經由一第一二極體與一第二二極體,來提高一疊接NMOS之上層與下層NMOS的閘極電位,藉此讓上層與下層NMOS產生通道,以幫助靜電更有效透過該疊接NMOS而導通至地。本發明在具有疊接NMOS架構之高低壓混合介面電路上設置觸發電路,以利用閘極耦合技術觸發導通該疊接NMOS,藉此增進疊接NMOS之靜電放電防護能力,並改善習知靜電放電防護電路無法直接套用於疊接 NMOS結構或需外加極大保護元件等缺失。zh_TW
dc.language.isozh_TWen_US
dc.title靜電放電防護電路zh_TW
dc.typePatentsen_US
dc.citation.patentcountryTWNzh_TW
dc.citation.patentnumberI231987zh_TW
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  1. I231987.pdf

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