無線通訊處理單元之場式可程閘陣列的實作

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DC 欄位	值	語言
dc.contributor.author	宋國華	en_US
dc.contributor.author	Sung,Kuo-Hua	en_US
dc.contributor.author	許騰尹	en_US
dc.contributor.author	Hsu, Terng-Yin	en_US
dc.date.accessioned	2015-11-26T00:55:39Z	-
dc.date.available	2015-11-26T00:55:39Z	-
dc.date.issued	2015	en_US
dc.identifier.uri	http://140.113.39.130/cdrfb3/record/nctu/#GT070156807	en_US
dc.identifier.uri	http://hdl.handle.net/11536/125932	-
dc.description.abstract	本論文說明如何以非常有限的FPGA資源,實作一個精簡版本的MIMO[1]-OFDM[2]系統的Wireless Processing Unit 平臺。在完整版本的MIMO-OFDM WPU 系統下，雖然不同的天線會使用到WPU 中相同的數位邏輯硬體資源及相似的無線訊號資料處理演算法，也可以使用軟體去改變或選擇執行流程，讓WPU中數位邏輯硬體的共用性達到最佳化，以因應不同的通訊規格.	zh_TW
dc.description.abstract	This thesis explains how to use a FPGA with very limited resources, building a reduced version of the MIMO-OFDM Wireless Processing Unit Platform.	en_US
dc.language.iso	zh_TW	en_US
dc.subject	時差平行併聯	zh_TW
dc.subject	精簡版WPU	zh_TW
dc.subject	管線化設計	zh_TW
dc.subject	效能最佳化的硬體描述語言	zh_TW
dc.subject	core generator	en_US
dc.subject	Wireless Processing Unit	en_US
dc.subject	Reconfigurable Memory	en_US
dc.subject	Reconfiguralbe Arithmetic Logic Unit	en_US
dc.title	無線通訊處理單元之場式可程閘陣列的實作	zh_TW
dc.title	FPGA implementation of Wireless Processing Unit	en_US
dc.type	Thesis	en_US
dc.contributor.department	資訊學院資訊學程	zh_TW
顯示於類別：	畢業論文