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dc.contributor.author江蕙如en_US
dc.contributor.authorJiang Iris Hui-Ruen_US
dc.date.accessioned2014-12-13T10:30:52Z-
dc.date.available2014-12-13T10:30:52Z-
dc.date.issued2005en_US
dc.identifier.govdocNSC94-2220-E009-042zh_TW
dc.identifier.urihttp://hdl.handle.net/11536/90508-
dc.identifier.urihttps://www.grb.gov.tw/search/planDetail?id=1147358&docId=220367en_US
dc.description.sponsorship行政院國家科學委員會zh_TW
dc.language.isozh_TWen_US
dc.title單晶片系統驗證之核心技術開發-子計畫四:單晶片系統設計流程之實體驗證(I)zh_TW
dc.titlePhysical Verification for SoC Design Flow(I)en_US
dc.typePlanen_US
dc.contributor.department交通大學電子工程系zh_TW
顯示於類別:研究計畫