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dc.contributor.author謝武聰en_US
dc.contributor.authorXIE, WU-CONGen_US
dc.contributor.author鄭晃忠en_US
dc.contributor.author吳慶源en_US
dc.contributor.authorZHEN, HUANG-ZHONGen_US
dc.contributor.authorWU, GING-YUANen_US
dc.date.accessioned2014-12-12T02:05:05Z-
dc.date.available2014-12-12T02:05:05Z-
dc.date.issued1987en_US
dc.identifier.urihttp://140.113.39.130/cdrfb3/record/nctu/#NT762430052en_US
dc.identifier.urihttp://hdl.handle.net/11536/53439-
dc.description.abstract薄膜電晶體已經被製造在不同厚度之低壓化學氣相沉積的複晶矽薄膜上,ID對VG轉換 曲線和ID對VD輸出特性被測量,開電流,關電流和開╱關流比亦被定義,能位障礙高 度,場效移動度,陷阱密度和臨界電壓均被粹取出來。隨著主動複晶矽厚度的降低, 離子佈植能量跟降低以提升元件特性。可以發現到主動複晶矽的厚度降低,並不會使 得元件的一些參數變差,像能位障礙高度,場效移動度,陷阱密度和臨界電壓都跟複 晶矽的厚度無多大的關係。然而當主動複晶矽的厚降低,可以得到更低的關電流,因 而提高開╱關的電流比,而且用較薄的複晶矽膜做成之薄膜電晶體有更好的輸出特出 。此外,陷阱密度值非常的高導致被做成的薄膜電晶體有很大的臨界電壓。 本論文,對於在薄膜電晶體中,複晶矽的厚度對元件特性的影響有很詳盡的探討。zh_TW
dc.language.isozh_TWen_US
dc.subject複晶矽zh_TW
dc.subject薄膜電晶體zh_TW
dc.subject電性zh_TW
dc.subject離子佈值能量zh_TW
dc.subject臨界電壓zh_TW
dc.subjectIDen_US
dc.subjectVGen_US
dc.subjectVDen_US
dc.title複晶矽之厚度對薄膜電晶體電性之影響zh_TW
dc.typeThesisen_US
dc.contributor.department電子研究所zh_TW
顯示於類別:畢業論文