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dc.contributor.author楊清堯en_US
dc.contributor.authorYANG, QING-YAOen_US
dc.contributor.author陳茂傑en_US
dc.contributor.authorCHEN, MAO-JIEen_US
dc.date.accessioned2014-12-12T02:09:30Z-
dc.date.available2014-12-12T02:09:30Z-
dc.date.issued1991en_US
dc.identifier.urihttp://140.113.39.130/cdrfb3/record/nctu/#NT802430073en_US
dc.identifier.urihttp://hdl.handle.net/11536/56109-
dc.description.abstract本論文主旨在於研究在複晶閘極上形成複晶矽化鉑對閘極氧化層特性造成的影響以 及如何降低複晶矽化鉑的片電阻以符合積體電路的基本需要。在對氧化層的影響方 面,複晶矽化鉑當作閘極雖崩潰電壓和崩潰電荷沒有影響但會稍微增加氧化層和矽 基底間介面的陷阱密度,其原因尚未知,不過可以確定不是因為矽化鉑的較大溫度 膨脹係數形成的熱應力所造成。就降低阻值方面,可在鍍鉑前先墊一層薄非晶矽並 確定在形成矽化物時這層非晶矽會被完全反應成矽化物以避免串聯電阻及串聯電容 。另外,本實驗也證實高於 650℃的溫度處理會增加介面陷阱密度,而這可以靠水 汽處理來改善。zh_TW
dc.language.isozh_TWen_US
dc.subject複晶矽化鉑zh_TW
dc.subject閘極氧化層特性zh_TW
dc.title複晶矽化鉑對閘極氧化層特性的影響zh_TW
dc.titleEffect of Pt polycide in the characteristics of gate oxideen_US
dc.typeThesisen_US
dc.contributor.department電子研究所zh_TW
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