記憶體子系統平行模擬環境之研製

標題:	記憶體子系統平行模擬環境之研製 Parallel Simulation Environment for Memory Subsystem Design
作者:	楊耀明 Yow-Ming Yang 陳正 Cheng Chen 資訊科學與工程研究所
關鍵字:	多處理系統;平行模擬;快取記憶體一致性;Multi-processor system;parallel simulation;cache coherence
公開日期:	1993
摘要:	本論文之目的在利用 PVM為工具來設計建立一個多處理機之平行記憶體模擬環境. 對於我們系統的設計上的重要考慮作探討包括了平行記憶體系統之設計,Two-level cache之設計, Multi-bank cache之設計, cache 一致協定(cache coherence protocals) 等. 並據此設計一記憶體模擬系統, 作為系統研究設計理念方法及其建立的方式做一詳細的說明.目前我們已將此記憶體模擬系統建立於SUNSPARC工作站上, 並完成初步的測試驗證工作. 同時我們也利用若干標竿程式(benchmark programs)在此模擬系統做模擬評估, 所得之結果可提供未來設計之重要參考.
URI:	http://140.113.39.130/cdrfb3/record/nctu/#NT820392035 http://hdl.handle.net/11536/57840
Appears in Collections:	Thesis