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dc.contributor.author王國禎en_US
dc.contributor.authorWANG KUO-CHENen_US
dc.date.accessioned2014-12-13T10:37:21Z-
dc.date.available2014-12-13T10:37:21Z-
dc.date.issued1999en_US
dc.identifier.govdocNSC88-2213-E009-039zh_TW
dc.identifier.urihttp://hdl.handle.net/11536/94570-
dc.identifier.urihttps://www.grb.gov.tw/search/planDetail?id=442129&docId=79964en_US
dc.description.sponsorship行政院國家科學委員會zh_TW
dc.language.isozh_TWen_US
dc.subject多處理器zh_TW
dc.subject單邊縱橫交換鍵zh_TW
dc.subject疊流式交換鍵控制協定zh_TW
dc.subject互接網路zh_TW
dc.subject硬體描述語言zh_TW
dc.subject現場可程式閘陣列zh_TW
dc.subjectMultiprocessoren_US
dc.subjectOne sided crossbar switchen_US
dc.subjectPipelined switch control protocolen_US
dc.subjectInterconnection networken_US
dc.subjectHardware description language (HDL)en_US
dc.subjectField programmable gate array (FPGA)en_US
dc.title單晶片多處理機設計之研究---子計畫III:單晶片多處理機可程式實驗平台之設計與實現(III)zh_TW
dc.titleDesign and Implementation of a Programmable Experimental Platform for a Single Chip with Multiple CPUs (III)en_US
dc.typePlanen_US
dc.contributor.department交通大學資訊科學研究所zh_TW
顯示於類別:研究計畫


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  1. 882213E009039.pdf

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