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dc.contributor.author陸志豪en_US
dc.contributor.author廖▲彦▼欽en_US
dc.contributor.author李鎮宜en_US
dc.contributor.author張錫嘉en_US
dc.contributor.author許雅三en_US
dc.date.accessioned2014-12-16T06:16:25Z-
dc.date.available2014-12-16T06:16:25Z-
dc.date.issued2008-07-03en_US
dc.identifier.govdocH03M013/19zh_TW
dc.identifier.urihttp://hdl.handle.net/11536/105850-
dc.description.abstract【課題】低密度パリティ検査（LDPC）デコーダに応用する演算方法、及び、その回路を提供する。【解決手段】本発明の低密度パリティ検査（LDPC）デコーダに応用する演算方法、及び、その回路は、元のビットノードをチェックノード中へ併入して同時に演算を実行し、元のチェックノードの入力メッセージを利用するだけで、新しいビットノードメッセージを生成し、チェックノードは本来の演算を再実行する時、同時に、新しいチェックノード出力メッセージと元のチェックノードの入力メッセージにより、ビットノードのメッセージを更新し、チェックノードが得るメッセージにより、本来のチェックノードの演算を実行するだけでなく、本来のビットノードの出力メッセージも同時に生成する。これにより、LDPCデコーダに必要なメモリ数量を効果的に減少させるだけでなく、デコード速度も増加できる。【選択図】図３zh_TW
dc.language.isozh_TWen_US
dc.title低密度パリティ検査（ＬＤＰＣ）デコーダに応用する演算方法、及び、その回路zh_TW
dc.typePatentsen_US
dc.citation.patentcountryJPNzh_TW
dc.citation.patentnumber2008154298zh_TW
顯示於類別：專利資料


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